利用电可擦除可编程逻辑器件实现DSP与SDRAM接口设计

利用电可擦除可编程逻辑器件实现DSP与SDRAM接口设计

DSP每次进行读、写操作时，首先向其I/O空间0002H和0003H写入SDRAM行和列地址，然后向I/O空间0001H写入控制命令，命令译码器根据命令寄存器中命令，译码后向仲裁电路发出读写请求。 刷新控制电路主要由1562计数器构成。由于TMS320C5402时钟频率为100MHz，SDRAM要求在32ms之内刷新2048行数据，因此该计数器计数值应小于： 32ms/2048/0.01μs＝1562.5。当计数器计满1562次时，刷新控制电路向仲裁电路发出刷新要求。 3.2 仲裁电路和命令产生器设计 仲裁电路接收命令接口模块解码的命令和刷新控制模块的刷新请求，产生适当的控制命令，其中刷新请求的优先级较高。当来自DSP的命令和来自刷新控制模块的刷新请求同时到达时，则首先执行刷新操作，然后执行来自DSP的命令。这样可以防止SDRAM的数据丢失。由此可知，仲裁电路实质上是一个优先级选择器。 命令产生器主要产生SDRAM读、写和刷新的控制时序（具体时序可见参考文献1）以及FIFO的读写控制信号，用以对SDRAM进行各种操作，其实质上是一个Mealy型状态机，利用VHDL语言可以很方便地实现，其状态转移图如图3所示。

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