一个完整的传感器接口仪表放大器来驱动ADC输入方案

一个完整的传感器接口仪表放大器来驱动ADC输入方案

本文将介绍最新整合解决方案，可以彻底解决工程师所提出超出当下能力范围的问题。文中并将详细介绍设计步骤，以便配置一个完整的传感器接口仪表放大器来驱动ADC输入。

图1：从传感器到达ADC的挑战

什么适合传感器？为何有问题？

这个问题的简短答案是仪表放大器。传感器适合连接的对象是仪表放大器。

ADC输入乐见什么？

图2：ADC输入驱动具有挑战性

要达到上述要求绝非易事，特别是对于低功耗驱动器而言。另外，由于半导体制程的现代化，ADC工作电源电压日渐下降。这种趋势的不良副作用之一，是ADC输入变得更容易受输入过压的影响，并可能造成伤害或损坏，而这就需要有外部电路来防范这种过压。此类外部电路不仅不能将任何可测量噪声加入讯号，而且不应限制带宽或引起任何形式的失真。另外还非常希望整个电路能快速反应，并能从过压事件中迅速地恢复。

偏移输入讯号以符合ADC模拟输入电压范围也存在挑战。为执行此任务而增加的任何电路组件都必须遵守前面列出的所有限制条件(即低失真、低噪声、足够的带宽等)。

如果仪表放大器能够直接驱动ADC就好了…

市面上的所有仪表放大器都存在一些缺点，因此需要更多电路组件才能完成从物理世界(传感器)到数字世界(ADC)的路径。传统上，仪表放大器不是驱动ADC的首选电路组件(某些ADC比其他ADC更精密)。仪表放大器所做的事情已经够多了，希望它做得更多似乎不公平！

克服ADC驱动器的谐波失真(HD)是一项困难的挑战。下面是ADC驱动器必须满足或超过的失真性能的表达式，其是ADC分辨率的函数：

因此，对于16位ENOB，SINAD≥98dB

目前市场上的仪表放大器通常不是为驱动ADC输入而设计的。造成这种情况的最常见的原因，是这些组件缺乏高分辨率ADC所需的线性度。线性度或谐波失真(也称为THD，即总谐波失真)是最有可能的限制因素，仪表放大器因此而无法直接驱动ADC。当复杂波形被数字化后，一旦其被失真项干扰，讯号便无法与此类干扰区分开来，数据撷取将被破坏！驱动器还应能够从之前解释的ADC输入电荷注入瞬态中快速稳定下来。

当下的解决方案得到改善

现在，新的仪表放大器系列不仅能够完成仪表放大器传统上所做的所有事情，而且能非常良好地直接驱动ADC并保护ADC输入！LT6372-1(支援0dB到60dB的增益)和LT6372-0.2(支持–14dB到+46dB的增益/衰减)可以协助完成精密传感器接口的任务，直接驱动ADC输入。

使用诸如LT6372系列的高精度、低噪声仪表放大器来直接驱动ADC模拟输入具有明显的优势，无需再增加一个放大或缓冲级。其中的一些好处包括：减少组件数量，降低功耗和成本，缩小电路板面积，提供高CMR、卓越的直流精度、低1/f噪声，透过单一组件选择增益。

LT6372-1和LT6372-0.2具有极高的输入阻抗，可以与传感器或类似讯号输入接口，并提供大增益(LT6372-1)或衰减(LT6372-0.2)而不会引起负载效应，同时其低失真和低噪声可确保精确转换而不会降低性能，支持16位和更低分辨率ADC以高达150kSPS的速率运作。图4显示在给定增益设定下，每个组件可实现的带宽。

图4：LT6372-1和LT6372-0.2在各种增益下的频率响应

LT6372-1失真与频率的关系参见图5，应确保失真项不会影响ADC在最高目标频率的THD性能。以ADCLTC2367-16为例，其SINAD规格为94.7dB。为确保驱动器不是主要因素，图5显示LT6372-1是小于约5kHz频率的合适选择。

图5：LT6372-1THD与频率的关系

LT6372-1用于ADC驱动器的精妙之处

图6：LT6372分离基准电压用于将讯号移至ADC模拟输入讯号范围内

LT6372系列的内建输出箝位(CLHI和CLLO)确保ADC的敏感输入不会受到正向或负向瞬变的破坏或可能的损害。该系列支持无失真的输出摆幅达到箝位电压，并能够快速响应和恢复，从而在可能的瞬变触发任一箝位之后保护ADC并使之迅速恢复正常工作。

有些SARADC的模拟输入为放大器驱动带来了具挑战性的负载。放大器需要有低噪声和快速建立特性，并具备高直流精度，以将干扰讯号的扰动保持在一个LSB或更小。更高的采样速率和更高阶的ADC对放大器的要求也更高。图7显示了典型SARADC的输入。

图7：采集/采样模式下的SARADC输入

图7所示的切换位置对应于采样或采集模式，在该模式下，模拟输入连接到采样电容CDAC，然后在下一会话开始转换。

ADC前端RC组件值设计

选择REXT和CEXT的值时要考虑很多因素。以下是影响FFT或其他方式测得的ADC动态响应的因素总结：

CEXT：充当输入电荷反冲的电荷桶，使电压阶跃最小，从而改善建立时间。

太大：可能会影响放大器稳定性，并可能将LPF滚降频率降得太低而无法让讯号通过。

太小：ADC输入的电荷反冲太大，无法及时建立。

REXT：在放大器输出和CEXT之间提供隔离，以确保稳定性。

太大：可能会使建立时间常数过长。当计入ADC输入非线性阻抗时，也可能导致THD升高1。可能会增加IR压降误差。

太小：由于CEXT，放大器可能变得不稳定或其正向路径建立可能会受到影响。

下面是设计REXT和CEXT值的一些设计步骤，以LT2367-16ADC为例，其由LT6372-1驱动，最大输入频率fIN为2kHz，采样速率为150kSPS：

选择足够大的CEXT充当电荷桶，大幅减少电荷反冲：

其中：

CDAC：ADC输入电容=45pF(LTC2367-16)

→CEXT=10nF(选定值)

使用下式计算ADC输入电压阶跃VSTEP：

其中：

VREF=5V(LTC2367-16)

CDAC:ADC输入电容=45pF(LTC2367-16)

CEXT=10nF(之前)

→VSTEP=22mV(计算值)

注意：此VSTEP函数假设CDAC在每个采样周期结束时都放电至地，LTC2367-16也是如此。参考文献1中的VSTEP公式使用了不同的假设，因为它是针对ADC架构的，CDAC电压对于每个样本保持不变。

假设阶跃输入以指数方式建立，计算需要多少个输入REXT×CEXT时间常数NTC才能建立：

其中：

VSTEP：之前计算的ADC输入电压阶跃

VHALF_LSB：LSB/2，单位为伏特。对于5VFS和16位，其为38µV(=5V/217)

→NTC=6.4个时间常数

计算时间常数τ:

其中：

tACQ：ADC采集时间；tACQ=tCYC–tHOLD

假设采样率为150kSPS：

tCYC=6.67μs(=1/150kHz)

tHOLD=0.54μs(LTC2367-16)

因此：tACQ=6.13μs

→τ≤0.96µs

在已知τ和CEXT的情况下，可以计算REXT

→REXT≤96Ω

现在我们有了外部RC值，所选ADC可以适当地建立。如果计算出的REXT过高，可以增加CEXT并重新计算REXT以减小其值，反之亦然。图8显示了CEXT的选定值和对应的REXT值，用以简化本例工作条件下的计算任务。

图8：ADC正确建立对应的外部输入RC关系。

使用前面的步骤找到合适的REXT和CEXT起始值。应执行基准检验和评估，并根据需要优化这些值，同时牢记此类变动对性能的影响。

总结

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