基于FPGA的ARINC429总线接口卡设计

基于FPGA的ARINC429总线接口卡设计

1 引言

2 ARINC429总线数据

3 FPGA内部逻辑设计

根据ARINC429总线协议，要完成数据的收发以及对USB总线接口的逻辑控制， FPGA 芯片应完成的逻辑功能框图如图1所示，其中虚线框中是FPGA实现的部分。

3.1 发送器

b）TRANS：进行数据的并串转换，同时进行奇偶校验，即每产生一位串行数据就进行一次异或运算，并由位数计数器控制计到31时就进入PARITY状态。

always @（busy，clk_tx，serial_data）

begin

if （busy）

begin

TTL1《=serial_data&clk_tx;

TTL0《=~serial_data&clk_tx;

end

else begin

TTL1《=0;

TTL0《=0;

end

end

endmodule

发送控制逻辑用于协调缓存和信号发生器之间的数据传递。在缓存非空、busy无效（信号发生器状态机处于TRANS状态下busy有效）的条件下，一旦允许转换信号entx有效，便开启缓存的读使能rden，并产生转换数据的装载信号load，以完成缓存数据的自动转换和发送。

版权声明：本文内容由网络用户投稿，版权归原作者所有，本站不拥有其著作权，亦不承担相应法律责任。如果您发现本站中有涉嫌抄袭或描述失实的内容，请联系我们jiasou666@gmail.com 处理，核实后本网站将在24小时内删除侵权内容。